安路科技取得FPGA布局优化相关专利,本方法可在布局阶段实现短逻辑线直连优化
创始人
2025-12-30 22:16:26
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12月30日消息,国家知识产权局信息显示,上海安路信息科技股份有限公司申请一项名为“FPGA集成电路布局优化方法、装置、设备及存储介质”的专利,授权公告号CN115238638B,授权公告日为2025年12月30日。申请公布号为CN115238638A,申请号为CN202210718272.X,申请公布日期为2025年12月30日,申请日期为2022年6月23日,发明人葛坤峰,专利代理机构广州三环专利商标代理有限公司,专利代理师陈旭红,分类号G06F30/3947。

专利摘要显示,本发明公开了一种FPGA集成电路布局优化方法、装置、设备及存储介质,所述方法包括:执行短逻辑连接线选定操作:从短逻辑连接线集中选取Slack值最低的短逻辑连接线作为选定短逻辑连接线;其中,短逻辑连接线为长度小于预设值的逻辑连接线:短逻辑连接线集为:初始时,FPGA集成电路中各短逻辑连接线的集合;执行第一移动操作,并在执行完第一移动操作后,将当前的选定短逻辑连接线从短逻辑连接线集中剔除,并重新执行短逻辑连接线选定操作;通过实施本发明实施例,能够在布局阶段实现短逻辑连接线的直连优化。

安路科技成立于 2011 年 11 月 18 日,于 2021 年 11 月 12 日在上海证券交易所上市,注册地址位于上海,办公地址同样在上海。它是国内可编程逻辑器件领域领先企业,专注 FPGA 芯片产品,具备芯片设计与 EDA 工具的稀缺全产业链能力。

安路科技主营业务为 FPGA 芯片和专用 EDA 软件的研发、设计和销售,所属申万行业为电子-半导体-数字芯片设计,涉及汽车芯片、机器人概念、人形机器人等概念板块。

2025 年三季度,安路科技实现营业收入 3.68 亿元,在行业 51 家公司中排名第 43,对比行业第一名豪威集团 217.83 亿元、第二名江波龙 167.34 亿元差距明显,低于行业平均数 27.87 亿元和中位数 11.41 亿元;当期净利润为 -1.91 亿元,行业排名 47/51,而第一名豪威集团为 31.99 亿元,第二名海光信息为 28.41 亿元,远逊于行业平均数 3.08 亿元和中位数 7294.09 万元。

上海安路信息科技股份有限公司近期专利情况如下:

序号专利名称专利类型法律状态申请号申请日期公开(公告)号公开(公告)日期发明人
1基于OpenOCD调试器的扫描USB设备的方法发明专利公布CN202510793726.32025-06-13CN120670242A2025-09-19王天一
2基于OpenOCD的自动测试平台发明专利公布CN202510793975.22025-06-13CN120670235A2025-09-19王天一
3基于OpenOCD调试器的支持QSPI闪存兼容模式的方法发明专利公布CN202510793974.82025-06-13CN120670245A2025-09-19王天一
4目标检测的后处理装置和方法发明专利实质审查的生效、公布CN202510793124.82025-06-13CN120747457A2025-10-03马成森
5数据压缩方法、模块、电子设备及调试系统发明专利实质审查的生效、公布CN202510524014.12025-04-24CN120377932A2025-07-25刘清燕
6数据分段压缩方法、模块和电子设备发明专利实质审查的生效、公布CN202510524018.X2025-04-24CN120389756A2025-07-29刘清燕
7IP核参数更新方法、装置、终端设备及存储介质发明专利实质审查的生效、公布CN202510522718.52025-04-24CN120493833A2025-08-15李珊妮、原育凯
8用于源同步通信的采样方法、装置、终端设备及存储介质发明专利实质审查的生效、公布CN202510446321.22025-04-10CN120185752A2025-06-20毕振华、李旻睿、唐博、刘阳
9用于AXI总线的主设备访问方法、装置、终端设备及存储介质发明专利实质审查的生效、公布CN202510410460.X2025-04-02CN120407486A2025-08-01刘清燕
10FPGA芯片的动态重配置方法、装置、终端设备及存储介质发明专利实质审查的生效、公布CN202510401393.52025-04-01CN120407037A2025-08-01郭德鑫、葛洪
11用于快速响应的信号失配补偿方法及电路发明专利实质审查的生效、公布CN202510202756.22025-02-24CN120200589A2025-06-24李寒、宋飞
12基于标准延迟单元的DDR写数据掩码训练系统及方法发明专利实质审查的生效、公布CN202510086034.52025-01-20CN120029941A2025-05-23董红伟、李小飞、欧阳淦
13基于标准延迟单元的DDR写数据眼图训练系统及方法发明专利实质审查的生效、公布CN202510086030.72025-01-20CN120029940A2025-05-23董红伟、李小飞、欧阳淦
14评估FPGA布局布线流程中互连开关块布通成功率的方法及基于该评估结果的布局优化方法发明专利授权CN202510087243.12025-01-20CN120012683B2025-11-11龚骏、刘辰
15基于FFT的数据传输方法及装置发明专利实质审查的生效、公布CN202510078695.32025-01-17CN120030267A2025-05-23马向华
16基于数据和控制信令分离的调试接口复用方法发明专利实质审查的生效、公布CN202510050323.X2025-01-13CN120011154A2025-05-16万瑞罡、洪啸宇
17多路选择器树的优化方法、装置、设备及介质发明专利实质审查的生效、公布CN202510001843.12025-01-02CN119906454A2025-04-29杨乾辉、胡平科
18多位宽电子森林的优化方法、装置、设备及介质发明专利实质审查的生效、公布CN202510001838.02025-01-02CN119906453A2025-04-29宋灿辉、金健、杨乾辉
19通用型分布式测试系统发明专利实质审查的生效、公布CN202510004385.72025-01-02CN119938425A2025-05-06袁智皓、徐春华
20评估引脚接入效率的方法及系统发明专利实质审查的生效、公布CN202510004335.92025-01-02CN119940271A2025-05-06宋络雅、刘辰
21基于JTAG接口的调试子系统及方法发明专利实质审查的生效、公布CN202510003281.42025-01-02CN119962451A2025-05-09洪啸宇、万瑞罡
22可编程逻辑器件的自动化测试方法及装置发明专利实质审查的生效、公布CN202411590854.X2024-11-08CN119535185A2025-02-28王葵军、鄢宜波
23三级串联的IO耐压驱动电路、电子器件及设备发明专利实质审查的生效、公布CN202411559116.92024-11-04CN119543916A2025-02-28王晓峰
24软错误注入系统发明专利实质审查的生效、实质审查的生效、公布CN202411486295.82024-10-23CN119512804A2025-02-25王荣贵、周家奇、姬广慎
25现场可编程系统级芯片的时钟同步方法发明专利实质审查的生效、公布CN202411470495.42024-10-21CN119336126A2025-01-21谌志强、郭宇飞
26现场可编程系统级芯片中存储器的烧录方法发明专利实质审查的生效、公布CN202411461702.X2024-10-18CN119397967A2025-02-07谌志强、刘越洋、黄中华
27芯片的同步开关噪声测试方法、装置及存储介质发明专利实质审查的生效、公布CN202411322344.42024-09-23CN119224534A2024-12-31翟文婷、沈费钦
28PCIe测试系统、方法、设备及介质发明专利实质审查的生效、公布CN202411299931.62024-09-18CN119311489A2025-01-14葛洪、郭德鑫
29基于FPGA的时钟同步方法及系统发明专利实质审查的生效、公布CN202411247833.82024-09-06CN119292414A2025-01-10万瑞罡
30SRAM唤醒方法及装置发明专利实质审查的生效、公布CN202411221742.72024-09-02CN119292446A2025-01-10王勇、潘淞
31使用ATPG工具实现可编程逻辑阵列的自动化测试方法及系统发明专利实质审查的生效、公布CN202411152880.42024-08-21CN119125839A2024-12-13蒙喜琨
32基于标准延迟单元的DDR读数据总线翻转信号眼图训练方法发明专利实质审查的生效、公布CN202411084575.62024-08-08CN118981439A2024-11-19董红伟、李小飞、欧阳淦
33FPGA内PCIe模块的快速加载方法、系统、设备及介质发明专利公布CN202411071608.32024-08-06CN118838664A2024-10-25郭德鑫、葛洪
34芯片供电管理电路和系统发明专利实质审查的生效、公布CN202411065350.62024-08-05CN119045634A2024-11-29袁智皓、王韬、陈启瑶、彭蓉蓉、沈费钦
35基于FPGA的芯片测试方法和装置发明专利实质审查的生效、公布CN202411041956.62024-07-31CN118962398A2024-11-15郑赫男、袁智皓、陈珊
36基于可编程器件的芯片锁定方法、装置、设备及存储介质发明专利实质审查的生效、公布CN202411040350.02024-07-31CN119089458A2024-12-06陈启瑶、王韬、陈艳波、梅晓玲
37用于识别软件功能适用性的正则表达式生成方法及系统发明专利实质审查的生效、公布CN202411042879.62024-07-31CN119202317A2024-12-27原育凯
38FPGA芯片的层次化静态时序分析方法及系统发明专利实质审查的生效、公布CN202411033713.82024-07-30CN119026542A2024-11-26孙斌、程祖哲、朱春
39基于FPGA器件移动的时序优化控制方法及装置发明专利实质审查的生效、公布CN202411023770.82024-07-29CN119167854A2024-12-20葛坤峰、刘榜、耿孝谨
40提高FPGA测试效率的方法发明专利实质审查的生效、公布CN202410968203.32024-07-18CN119003253A2024-11-22胡智勇、袁智皓、厚娇、李知远
41FPGA码流加载的控制方法、装置、终端设备及存储介质发明专利实质审查的生效、公布CN202410928087.22024-07-11CN118869672A2024-10-29邵桢瑜、周家奇、厚娇、朱宇超
42FFT输入层结构及其数据传输方法发明专利公布CN202410915683.72024-07-09CN118885710A2024-11-01马向华、边立剑
43码流加载系统和方法发明专利公布CN202410915678.62024-07-09CN118886015A2024-11-01徐庆嵩、杨益、张超
44FPGA单元及其对应的用户自定义前导码的处理方法发明专利公布CN202410900587.52024-07-05CN118764552A2024-10-11仇斌
45基于FPGA的HardIP接口模块及其实现方法发明专利实质审查的生效、公布CN202410900584.12024-07-05CN118798112A2024-10-18李小飞
46防止FPGA配置码流被DPA攻击的电路及包括该电路的FPGA发明专利公布CN202410879570.62024-07-02CN118761104A2024-10-11胡智勇、厚娇、仇斌、周家奇
47基于三商计算的除法运算系统发明专利实质审查的生效、公布CN202410871997.12024-07-01CN118605835A2024-09-06胡平科、余建德
48多BANK时钟偏移调节电路及FPGA芯片发明专利实质审查的生效、公布CN202410859128.72024-06-28CN118795982A2024-10-18李小飞
49FPGA芯片的调试电路、芯片电路的编程方法、设备及介质发明专利实质审查的生效、公布CN202410859125.32024-06-28CN118858884A2024-10-29潘淞、黄中华、王勇
50启动间隔值的获取方法、装置和高层次综合系统发明专利实质审查的生效、公布CN202410860348.12024-06-28CN118862761A2024-10-29刘清燕、边立剑

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